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        SPW總線節(jié)點(diǎn)控制器

        OBT-SPW-T是歐比特公司自主研制的遵循ECSS-E-ST-50-12C協(xié)議規(guī)范的航天設(shè)備間的高速數(shù)據(jù)總線的節(jié)點(diǎn)IP核。

         

           產(chǎn)品描述

         

        OBT-SPW-T可以嵌入在航天子系統(tǒng)中,將航天子系統(tǒng)中與SPW網(wǎng)絡(luò)連接,保證航天子系統(tǒng)之間高速、實(shí)時(shí)、確定、可靠地進(jìn)行數(shù)據(jù)交換。

         

           產(chǎn)品特性

         

        1 OBT-SPW-T功能結(jié)構(gòu)框圖

         

        1. 主要特征:

        ?遵循ECSS-E-ST-50-12C規(guī)范(兼容ECSS- E-50-12A);

        ?可提供雙向全雙工、串行的高速spw鏈路網(wǎng)絡(luò)接口(2-200Mbits/s),支持配置遠(yuǎn)程存儲(chǔ)訪問(RMAP)功能;

        ?硬件邏輯實(shí)現(xiàn)物理層(PHY)、信號(hào)層、字符層、交換層以及數(shù)據(jù)包層協(xié)議;

        ?高性能的AMBA總線與主機(jī)間的數(shù)據(jù)傳輸;

        ?支持點(diǎn)對(duì)點(diǎn)的鏈路以及路由交換網(wǎng)絡(luò);

        ?物理層采用LVDS技術(shù),使SPW具有良好的EMC特性和更高的傳輸速率。

        主要功能:

        ?配置管理:負(fù)責(zé)對(duì)SPW終端節(jié)點(diǎn)的功能控制寄存器、節(jié)點(diǎn)狀態(tài)寄存器、鏈路地址、時(shí)鐘分頻寄存器、直接存儲(chǔ)訪問(DMA)通道控制寄存器等進(jìn)行參數(shù)配置;

        ?PHY:對(duì)接收到的采用DS(Data-Strobe)方式傳輸?shù)臄?shù)據(jù)進(jìn)行恢復(fù);

        ?鏈路接口控制狀態(tài)機(jī):處理SPW鏈路的交換層協(xié)議,實(shí)現(xiàn)鏈路的正常連接、鏈路錯(cuò)誤檢測(cè)、鏈路斷路恢復(fù)連接等功能;

        ?數(shù)據(jù)接收器:對(duì)經(jīng)過PHY處理的數(shù)據(jù)進(jìn)行進(jìn)一步處理,實(shí)現(xiàn)信號(hào)層和字符層協(xié)議;

        ?遠(yuǎn)程存儲(chǔ)訪問數(shù)接收器:接收遵守RMAP協(xié)議傳輸來(lái)的數(shù)據(jù);

        ?遠(yuǎn)程存儲(chǔ)訪問數(shù)發(fā)送器:發(fā)送遵守RMAP協(xié)議的數(shù)據(jù);

        ?直接存儲(chǔ)訪問:實(shí)現(xiàn)數(shù)據(jù)與主機(jī)之間的直接交換;

        ?數(shù)據(jù)發(fā)送器:將數(shù)據(jù)轉(zhuǎn)換為DS模式進(jìn)行發(fā)送,實(shí)現(xiàn)信號(hào)層和字符層協(xié)議。

        實(shí)例應(yīng)用:

        基于圖1中的結(jié)構(gòu),將主機(jī)接口替換為PCI接口,將直接存儲(chǔ)訪問替換為DPRAM,可以得到下圖2所示的應(yīng)用結(jié)構(gòu)。該方案為Orbita研發(fā)的基于PCI接口的Spacewire終端節(jié)點(diǎn)板卡EMBC1000-PCISPW

         

        2 EMBC1000-PCISPW功能結(jié)構(gòu)框圖

        2. 資源利用情況

         OBT-SPW-T資源評(píng)估(1spw收發(fā)):

        1Spacewire收發(fā)消耗的資源,資源中的PLLSpaceWire收發(fā)端模塊使用的倍頻時(shí)鐘。

        Altera Cyclone III:

            LE:  3,433

            Memory bits:  3,712

        Xilinx Virtex2:

             Slices:  1,802

             LUTs:  2,794

             Memory bits: 3,712(Block RAMs: 2)

             Flip-Flops: 1,398

        Xilinx Virtex5:

             Slices  :  801

             LUTs  :  1,788

             Memory bits : 3,712(18K Block RAMs: 2)

             Flip-Flops : 2,218

        Actel  ProASIC3:

             D-flip-flops(CORE)  :  3,143

             Memory bits : 3,712 (Block: 2) 

         

           產(chǎn)品列表

         

        #

        產(chǎn)品型號(hào)

        產(chǎn)品描述

        備注

        1

         OBTIP-SPW-T-F

         ASIC版本固核(ASIC網(wǎng)表)

         /

        2

         OBTIP-SPW-T-V

         FPGA版本固核(FPGA網(wǎng)表)

         /

        3

         OBTIP-SPW-T-S

         軟核(RTL源碼)

         /


        4Mb 8Mb 16Mb 32Mb

        • Part Number Configuration Voltage Clock Rate / Access time Package Temperature SCD#
          暫無(wú)記錄
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